nv50: add initial context for chipset 0xaa

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diff --git a/shared-core/nv50_graph.c b/shared-core/nv50_graph.c
index 2fb6f967..9c9156ab 100644
--- a/shared-core/nv50_graph.c
+++ b/shared-core/nv50_graph.c
@@ -7421,6 +7421,722 @@ nv92_graph_init_ctxvals(struct drm_device *dev, struct nouveau_gpuobj_ref *ref)
 	INSTANCE_WR(ctx, 0x651FC/4, 0x1);
 }
 
+static void
+nvaa_graph_init_ctxvals(struct drm_device *dev, struct nouveau_gpuobj_ref *ref)
+{
+	struct drm_nouveau_private *dev_priv = dev->dev_private;
+	struct nouveau_gpuobj *ctx = ref->gpuobj;
+
+	INSTANCE_WR(ctx, 0x0010c/4, 0x00000030);
+	INSTANCE_WR(ctx, 0x001d0/4, 0x00000003);
+	INSTANCE_WR(ctx, 0x001d4/4, 0x00001000);
+	INSTANCE_WR(ctx, 0x00220/4, 0x0000fe0c);
+	INSTANCE_WR(ctx, 0x00238/4, 0x00001000);
+	INSTANCE_WR(ctx, 0x00264/4, 0x00000187);
+	INSTANCE_WR(ctx, 0x00278/4, 0x00001018);
+	INSTANCE_WR(ctx, 0x0027c/4, 0x000000ff);
+	INSTANCE_WR(ctx, 0x002c8/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x002cc/4, 0x042500df);
+	INSTANCE_WR(ctx, 0x002d4/4, 0x00000600);
+	INSTANCE_WR(ctx, 0x002ec/4, 0x01000000);
+	INSTANCE_WR(ctx, 0x002f0/4, 0x000000ff);
+	INSTANCE_WR(ctx, 0x002f8/4, 0x00000800);
+	INSTANCE_WR(ctx, 0x00310/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00310/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00310/4, 0x000e0080);
+	INSTANCE_WR(ctx, 0x00310/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00338/4, 0x00000002);
+	INSTANCE_WR(ctx, 0x0033c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0034c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00350/4, 0x00000100);
+	INSTANCE_WR(ctx, 0x00368/4, 0x00000002);
+	INSTANCE_WR(ctx, 0x0036c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00370/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00380/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00384/4, 0x003fffff);
+	INSTANCE_WR(ctx, 0x00388/4, 0x00001fff);
+	INSTANCE_WR(ctx, 0x00390/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00394/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0039c/4, 0x00000007);
+	INSTANCE_WR(ctx, 0x003bc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x003bc/4, 0x00000007);
+	INSTANCE_WR(ctx, 0x003bc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x003bc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x003bc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x003e0/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x003e4/4, 0x00000100);
+	INSTANCE_WR(ctx, 0x003ec/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x003f8/4, 0x00000100);
+	INSTANCE_WR(ctx, 0x003fc/4, 0x00000001);
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+	INSTANCE_WR(ctx, 0x00408/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00414/4, 0x00000100);
+	INSTANCE_WR(ctx, 0x00428/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x0042c/4, 0x00000070);
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+	INSTANCE_WR(ctx, 0x0044c/4, 0x00000008);
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+	INSTANCE_WR(ctx, 0x00458/4, 0x00000027);
+	INSTANCE_WR(ctx, 0x00458/4, 0x00000026);
+	INSTANCE_WR(ctx, 0x00458/4, 0x00000008);
+	INSTANCE_WR(ctx, 0x00458/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00458/4, 0x00000027);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000002);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000003);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000005);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000006);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000007);
+	INSTANCE_WR(ctx, 0x00478/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x004d8/4, 0x000000cf);
+	INSTANCE_WR(ctx, 0x00508/4, 0x00000080);
+	INSTANCE_WR(ctx, 0x00508/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00508/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00508/4, 0x00000003);
+	INSTANCE_WR(ctx, 0x00508/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00524/4, 0x00000012);
+	INSTANCE_WR(ctx, 0x00524/4, 0x00000010);
+	INSTANCE_WR(ctx, 0x00524/4, 0x0000000c);
+	INSTANCE_WR(ctx, 0x00524/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00540/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00544/4, 0x00000002);
+	INSTANCE_WR(ctx, 0x00548/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x00558/4, 0x003fffff);
+	INSTANCE_WR(ctx, 0x0055c/4, 0x00001fff);
+	INSTANCE_WR(ctx, 0x00584/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00588/4, 0x00000001);
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+	INSTANCE_WR(ctx, 0x00598/4, 0x00000014);
+	INSTANCE_WR(ctx, 0x0059c/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005a8/4, 0x00000002);
+	INSTANCE_WR(ctx, 0x005bc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005c4/4, 0x00000002);
+	INSTANCE_WR(ctx, 0x005c4/4, 0x00001000);
+	INSTANCE_WR(ctx, 0x005c4/4, 0x00000e00);
+	INSTANCE_WR(ctx, 0x005c4/4, 0x00001000);
+	INSTANCE_WR(ctx, 0x005c4/4, 0x00001e00);
+	INSTANCE_WR(ctx, 0x005dc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005dc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005dc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005dc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005dc/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x005fc/4, 0x00000200);
+	INSTANCE_WR(ctx, 0x00604/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x00608/4, 0x000000f0);
+	INSTANCE_WR(ctx, 0x0060c/4, 0x000000ff);
+	INSTANCE_WR(ctx, 0x00618/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x0061c/4, 0x000000f0);
+	INSTANCE_WR(ctx, 0x00620/4, 0x000000ff);
+	INSTANCE_WR(ctx, 0x00628/4, 0x00000009);
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+	INSTANCE_WR(ctx, 0x00658/4, 0x00000002);
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+	INSTANCE_WR(ctx, 0x006a4/4, 0x00001000);
+	INSTANCE_WR(ctx, 0x006a8/4, 0x000000ff);
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+	INSTANCE_WR(ctx, 0x1a980/4, 0x04000000);
+	INSTANCE_WR(ctx, 0x1a9a0/4, 0x04000000);
+	INSTANCE_WR(ctx, 0x1ae40/4, 0x04e3bfdf);
+	INSTANCE_WR(ctx, 0x1ae60/4, 0x04e3bfdf);
+	INSTANCE_WR(ctx, 0x1aec0/4, 0x0001fe21);
+	INSTANCE_WR(ctx, 0x1aee0/4, 0x0fac6881);
+	INSTANCE_WR(ctx, 0x1af80/4, 0x08100c12);
+	INSTANCE_WR(ctx, 0x1b020/4, 0x00000100);
+	INSTANCE_WR(ctx, 0x1b080/4, 0x00010001);
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+	INSTANCE_WR(ctx, 0x1b0e0/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x1b100/4, 0x00010001);
+	INSTANCE_WR(ctx, 0x1b120/4, 0x00000001);
+	INSTANCE_WR(ctx, 0x1b140/4, 0x00000004);
+	INSTANCE_WR(ctx, 0x1b160/4, 0x00000002);
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+	INSTANCE_WR(ctx, 0x49700/4, 0x00000011);
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+	INSTANCE_WR(ctx, 0x0012c/4, 0x00000002);
+}
+
 int
 nv50_graph_create_context(struct nouveau_channel *chan)
 {
@@ -7450,7 +8166,10 @@ nv50_graph_create_context(struct nouveau_channel *chan)
 
 	INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x00000/4,
 		    chan->ramin->instance >> 12);
-	INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x0011c/4, 0x00000002);
+	if (dev_priv->chipset == 0xaa)
+		INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x00004/4, 0x00000002);
+	else
+		INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x0011c/4, 0x00000002);
 
 	switch (dev_priv->chipset) {
 	case 0x50:
@@ -7465,6 +8184,9 @@ nv50_graph_create_context(struct nouveau_channel *chan)
 	case 0x92:
 		nv92_graph_init_ctxvals(dev, chan->ramin_grctx);
 		break;
+	case 0xaa:
+		nvaa_graph_init_ctxvals(dev, chan->ramin_grctx);
+		break;
 	default:
 		/* This is complete crack, it accidently used to make at
 		 * least some G8x cards work partially somehow, though there's